drivers/net/ixgbe/ixgbe.h

   1 /*******************************************************************************
   2
   3   Intel 10 Gigabit PCI Express Linux driver
   4   Copyright(c) 1999 - 2010 Intel Corporation.
   5
   6   This program is free software; you can redistribute it and/or modify it
   7   under the terms and conditions of the GNU General Public License,
   8   version 2, as published by the Free Software Foundation.
   9
  10   This program is distributed in the hope it will be useful, but WITHOUT
  11   ANY WARRANTY; without even the implied warranty of MERCHANTABILITY or
  12   FITNESS FOR A PARTICULAR PURPOSE.  See the GNU General Public License for
  13   more details.
  14
  15   You should have received a copy of the GNU General Public License along with
  16   this program; if not, write to the Free Software Foundation, Inc.,
  17   51 Franklin St - Fifth Floor, Boston, MA 02110-1301 USA.
  18
  19   The full GNU General Public License is included in this distribution in
  20   the file called "COPYING".
  21
  22   Contact Information:
  23   e1000-devel Mailing List <e1000-devel@lists.sourceforge.net>
  24   Intel Corporation, 5200 N.E. Elam Young Parkway, Hillsboro, OR 97124-6497
  25
  26 *******************************************************************************/
  27
  28 #ifndef _IXGBE_H_
  29 #define _IXGBE_H_
  30
  31 #include <linux/bitops.h>
  32 #include <linux/types.h>
  33 #include <linux/pci.h>
  34 #include <linux/netdevice.h>
  35 #include <linux/cpumask.h>
  36 #include <linux/aer.h>
  37 #include <linux/if_vlan.h>
  38
  39 #include "ixgbe_type.h"
  40 #include "ixgbe_common.h"
  41 #include "ixgbe_dcb.h"
  42 #if defined(CONFIG_FCOE) || defined(CONFIG_FCOE_MODULE)
  43 #define IXGBE_FCOE
  44 #include "ixgbe_fcoe.h"
  45 #endif /* CONFIG_FCOE or CONFIG_FCOE_MODULE */
  46 #ifdef CONFIG_IXGBE_DCA
  47 #include <linux/dca.h>
  48 #endif
  49
  50 /* common prefix used by pr_<> macros */
  51 #undef pr_fmt
  52 #define pr_fmt(fmt) KBUILD_MODNAME ": " fmt
  53
  54 /* TX/RX descriptor defines */
  55 #define IXGBE_DEFAULT_TXD                   512
  56 #define IXGBE_MAX_TXD                      4096
  57 #define IXGBE_MIN_TXD                        64
  58
  59 #define IXGBE_DEFAULT_RXD                   512
  60 #define IXGBE_MAX_RXD                      4096
  61 #define IXGBE_MIN_RXD                        64
  62
  63 /* flow control */
  64 #define IXGBE_MIN_FCRTL                    0x40
  65 #define IXGBE_MAX_FCRTL                 0x7FF80
  66 #define IXGBE_MIN_FCRTH                   0x600
  67 #define IXGBE_MAX_FCRTH                 0x7FFF0
  68 #define IXGBE_DEFAULT_FCPAUSE            0xFFFF
  69 #define IXGBE_MIN_FCPAUSE                     0
  70 #define IXGBE_MAX_FCPAUSE                0xFFFF
  71
  72 /* Supported Rx Buffer Sizes */
  73 #define IXGBE_RXBUFFER_512   512    /* Used for packet split */
  74 #define IXGBE_RXBUFFER_2048  2048
  75 #define IXGBE_RXBUFFER_4096  4096
  76 #define IXGBE_RXBUFFER_8192  8192
  77 #define IXGBE_MAX_RXBUFFER   16384  /* largest size for a single descriptor */
  78
  79 /*
  80  * NOTE: netdev_alloc_skb reserves up to 64 bytes, NET_IP_ALIGN mans we
  81  * reserve 2 more, and skb_shared_info adds an additional 384 bytes more,
  82  * this adds up to 512 bytes of extra data meaning the smallest allocation
  83  * we could have is 1K.
  84  * i.e. RXBUFFER_512 --> size-1024 slab
  85  */
  86 #define IXGBE_RX_HDR_SIZE IXGBE_RXBUFFER_512
  87
  88 #define MAXIMUM_ETHERNET_VLAN_SIZE (ETH_FRAME_LEN + ETH_FCS_LEN + VLAN_HLEN)
  89
  90 /* How many Rx Buffers do we bundle into one write to the hardware ? */
  91 #define IXGBE_RX_BUFFER_WRITE   16      /* Must be power of 2 */
  92
  93 #define IXGBE_TX_FLAGS_CSUM             (u32)(1)
  94 #define IXGBE_TX_FLAGS_VLAN             (u32)(1 << 1)
  95 #define IXGBE_TX_FLAGS_TSO              (u32)(1 << 2)
  96 #define IXGBE_TX_FLAGS_IPV4             (u32)(1 << 3)
  97 #define IXGBE_TX_FLAGS_FCOE             (u32)(1 << 4)
  98 #define IXGBE_TX_FLAGS_FSO              (u32)(1 << 5)
  99 #define IXGBE_TX_FLAGS_VLAN_MASK        0xffff0000
 100 #define IXGBE_TX_FLAGS_VLAN_PRIO_MASK   0x0000e000
 101 #define IXGBE_TX_FLAGS_VLAN_SHIFT       16
 102
 103 #define IXGBE_MAX_RSC_INT_RATE          162760
 104
 105 #define IXGBE_MAX_VF_MC_ENTRIES         30
 106 #define IXGBE_MAX_VF_FUNCTIONS          64
 107 #define IXGBE_MAX_VFTA_ENTRIES          128
 108 #define MAX_EMULATION_MAC_ADDRS         16
 109 #define VMDQ_P(p)   ((p) + adapter->num_vfs)
 110
 111 struct vf_data_storage {
 112         unsigned char vf_mac_addresses[ETH_ALEN];
 113         u16 vf_mc_hashes[IXGBE_MAX_VF_MC_ENTRIES];
 114         u16 num_vf_mc_hashes;
 115         u16 default_vf_vlan_id;
 116         u16 vlans_enabled;
 117         bool clear_to_send;
 118         bool pf_set_mac;
 119         u16 pf_vlan; /* When set, guest VLAN config not allowed. */
 120         u16 pf_qos;
 121 };
 122
 123 /* wrapper around a pointer to a socket buffer,
 124  * so a DMA handle can be stored along with the buffer */
 125 struct ixgbe_tx_buffer {
 126         struct sk_buff *skb;
 127         dma_addr_t dma;
 128         unsigned long time_stamp;
 129         u16 length;
 130         u16 next_to_watch;
 131         unsigned int bytecount;
 132         u16 gso_segs;
 133         u8 mapped_as_page;
 134 };
 135
 136 struct ixgbe_rx_buffer {
 137         struct sk_buff *skb;
 138         dma_addr_t dma;
 139         struct page *page;
 140         dma_addr_t page_dma;
 141         unsigned int page_offset;
 142 };
 143
 144 struct ixgbe_queue_stats {
 145         u64 packets;
 146         u64 bytes;
 147 };
 148
 149 struct ixgbe_ring {
 150         void *desc;                     /* descriptor ring memory */
 151         struct device *dev;             /* device for DMA mapping */
 152         union {
 153                 struct ixgbe_tx_buffer *tx_buffer_info;
 154                 struct ixgbe_rx_buffer *rx_buffer_info;
 155         };
 156         u8 atr_sample_rate;
 157         u8 atr_count;
 158         u16 count;                      /* amount of descriptors */
 159         u16 rx_buf_len;
 160         u16 next_to_use;
 161         u16 next_to_clean;
 162
 163         u8 queue_index; /* needed for multiqueue queue management */
 164
 165 #define IXGBE_RING_RX_PS_ENABLED                (u8)(1)
 166         u8 flags;                       /* per ring feature flags */
 167         u8 __iomem *tail;
 168
 169         unsigned int total_bytes;
 170         unsigned int total_packets;
 171
 172 #ifdef CONFIG_IXGBE_DCA
 173         /* cpu for tx queue */
 174         int cpu;
 175 #endif
 176
 177         u16 work_limit;                 /* max work per interrupt */
 178         u16 reg_idx;                    /* holds the special value that gets
 179                                          * the hardware register offset
 180                                          * associated with this ring, which is
 181                                          * different for DCB and RSS modes
 182                                          */
 183
 184         struct ixgbe_queue_stats stats;
 185         struct u64_stats_sync syncp;
 186         int numa_node;
 187         unsigned long reinit_state;
 188         u64 rsc_count;                  /* stat for coalesced packets */
 189         u64 rsc_flush;                  /* stats for flushed packets */
 190         u32 restart_queue;              /* track tx queue restarts */
 191         u32 non_eop_descs;              /* track hardware descriptor chaining */
 192
 193         unsigned int size;              /* length in bytes */
 194         dma_addr_t dma;                 /* phys. address of descriptor ring */
 195         struct rcu_head rcu;
 196 } ____cacheline_internodealigned_in_smp;
 197
 198 enum ixgbe_ring_f_enum {
 199         RING_F_NONE = 0,
 200         RING_F_DCB,
 201         RING_F_VMDQ,  /* SR-IOV uses the same ring feature */
 202         RING_F_RSS,
 203         RING_F_FDIR,
 204 #ifdef IXGBE_FCOE
 205         RING_F_FCOE,
 206 #endif /* IXGBE_FCOE */
 207
 208         RING_F_ARRAY_SIZE      /* must be last in enum set */
 209 };
 210
 211 #define IXGBE_MAX_DCB_INDICES   8
 212 #define IXGBE_MAX_RSS_INDICES  16
 213 #define IXGBE_MAX_VMDQ_INDICES 64
 214 #define IXGBE_MAX_FDIR_INDICES 64
 215 #ifdef IXGBE_FCOE
 216 #define IXGBE_MAX_FCOE_INDICES  8
 217 #define MAX_RX_QUEUES (IXGBE_MAX_FDIR_INDICES + IXGBE_MAX_FCOE_INDICES)
 218 #define MAX_TX_QUEUES (IXGBE_MAX_FDIR_INDICES + IXGBE_MAX_FCOE_INDICES)
 219 #else
 220 #define MAX_RX_QUEUES IXGBE_MAX_FDIR_INDICES
 221 #define MAX_TX_QUEUES IXGBE_MAX_FDIR_INDICES
 222 #endif /* IXGBE_FCOE */
 223 struct ixgbe_ring_feature {
 224         int indices;
 225         int mask;
 226 } ____cacheline_internodealigned_in_smp;
 227
 228
 229 #define MAX_RX_PACKET_BUFFERS ((adapter->flags & IXGBE_FLAG_DCB_ENABLED) \
 230                               ? 8 : 1)
 231 #define MAX_TX_PACKET_BUFFERS MAX_RX_PACKET_BUFFERS
 232
 233 /* MAX_MSIX_Q_VECTORS of these are allocated,
 234  * but we only use one per queue-specific vector.
 235  */
 236 struct ixgbe_q_vector {
 237         struct ixgbe_adapter *adapter;
 238         unsigned int v_idx; /* index of q_vector within array, also used for
 239                              * finding the bit in EICR and friends that
 240                              * represents the vector for this ring */
 241         struct napi_struct napi;
 242         DECLARE_BITMAP(rxr_idx, MAX_RX_QUEUES); /* Rx ring indices */
 243         DECLARE_BITMAP(txr_idx, MAX_TX_QUEUES); /* Tx ring indices */
 244         u8 rxr_count;     /* Rx ring count assigned to this vector */
 245         u8 txr_count;     /* Tx ring count assigned to this vector */
 246         u8 tx_itr;
 247         u8 rx_itr;
 248         u32 eitr;
 249         cpumask_var_t affinity_mask;
 250 };
 251
 252 /* Helper macros to switch between ints/sec and what the register uses.
 253  * And yes, it's the same math going both ways.  The lowest value
 254  * supported by all of the ixgbe hardware is 8.
 255  */
 256 #define EITR_INTS_PER_SEC_TO_REG(_eitr) \
 257         ((_eitr) ? (1000000000 / ((_eitr) * 256)) : 8)
 258 #define EITR_REG_TO_INTS_PER_SEC EITR_INTS_PER_SEC_TO_REG
 259
 260 #define IXGBE_DESC_UNUSED(R) \
 261         ((((R)->next_to_clean > (R)->next_to_use) ? 0 : (R)->count) + \
 262         (R)->next_to_clean - (R)->next_to_use - 1)
 263
 264 #define IXGBE_RX_DESC_ADV(R, i)     \
 265         (&(((union ixgbe_adv_rx_desc *)((R)->desc))[i]))
 266 #define IXGBE_TX_DESC_ADV(R, i)     \
 267         (&(((union ixgbe_adv_tx_desc *)((R)->desc))[i]))
 268 #define IXGBE_TX_CTXTDESC_ADV(R, i)         \
 269         (&(((struct ixgbe_adv_tx_context_desc *)((R)->desc))[i]))
 270
 271 #define IXGBE_MAX_JUMBO_FRAME_SIZE        16128
 272 #ifdef IXGBE_FCOE
 273 /* Use 3K as the baby jumbo frame size for FCoE */
 274 #define IXGBE_FCOE_JUMBO_FRAME_SIZE       3072
 275 #endif /* IXGBE_FCOE */
 276
 277 #define OTHER_VECTOR 1
 278 #define NON_Q_VECTORS (OTHER_VECTOR)
 279
 280 #define MAX_MSIX_VECTORS_82599 64
 281 #define MAX_MSIX_Q_VECTORS_82599 64
 282 #define MAX_MSIX_VECTORS_82598 18
 283 #define MAX_MSIX_Q_VECTORS_82598 16
 284
 285 #define MAX_MSIX_Q_VECTORS MAX_MSIX_Q_VECTORS_82599
 286 #define MAX_MSIX_COUNT MAX_MSIX_VECTORS_82599
 287
 288 #define MIN_MSIX_Q_VECTORS 2
 289 #define MIN_MSIX_COUNT (MIN_MSIX_Q_VECTORS + NON_Q_VECTORS)
 290
 291 /* board specific private data structure */
 292 struct ixgbe_adapter {
 293         struct timer_list watchdog_timer;
 294         unsigned long active_vlans[BITS_TO_LONGS(VLAN_N_VID)];
 295         u16 bd_number;
 296         struct work_struct reset_task;
 297         struct ixgbe_q_vector *q_vector[MAX_MSIX_Q_VECTORS];
 298         char name[MAX_MSIX_COUNT][IFNAMSIZ + 9];
 299         struct ixgbe_dcb_config dcb_cfg;
 300         struct ixgbe_dcb_config temp_dcb_cfg;
 301         u8 dcb_set_bitmap;
 302         enum ixgbe_fc_mode last_lfc_mode;
 303
 304         /* Interrupt Throttle Rate */
 305         u32 rx_itr_setting;
 306         u32 tx_itr_setting;
 307         u16 eitr_low;
 308         u16 eitr_high;
 309
 310         /* TX */
 311         struct ixgbe_ring *tx_ring[MAX_TX_QUEUES] ____cacheline_aligned_in_smp;
 312         int num_tx_queues;
 313         u32 tx_timeout_count;
 314         bool detect_tx_hung;
 315
 316         u64 restart_queue;
 317         u64 lsc_int;
 318
 319         /* RX */
 320         struct ixgbe_ring *rx_ring[MAX_RX_QUEUES] ____cacheline_aligned_in_smp;
 321         int num_rx_queues;
 322         int num_rx_pools;               /* == num_rx_queues in 82598 */
 323         int num_rx_queues_per_pool;     /* 1 if 82598, can be many if 82599 */
 324         u64 hw_csum_rx_error;
 325         u64 hw_rx_no_dma_resources;
 326         u64 non_eop_descs;
 327         int num_msix_vectors;
 328         int max_msix_q_vectors;         /* true count of q_vectors for device */
 329         struct ixgbe_ring_feature ring_feature[RING_F_ARRAY_SIZE];
 330         struct msix_entry *msix_entries;
 331
 332         u32 alloc_rx_page_failed;
 333         u32 alloc_rx_buff_failed;
 334
 335         /* Some features need tri-state capability,
 336          * thus the additional *_CAPABLE flags.
 337          */
 338         u32 flags;
 339 #define IXGBE_FLAG_RX_CSUM_ENABLED              (u32)(1)
 340 #define IXGBE_FLAG_MSI_CAPABLE                  (u32)(1 << 1)
 341 #define IXGBE_FLAG_MSI_ENABLED                  (u32)(1 << 2)
 342 #define IXGBE_FLAG_MSIX_CAPABLE                 (u32)(1 << 3)
 343 #define IXGBE_FLAG_MSIX_ENABLED                 (u32)(1 << 4)
 344 #define IXGBE_FLAG_RX_1BUF_CAPABLE              (u32)(1 << 6)
 345 #define IXGBE_FLAG_RX_PS_CAPABLE                (u32)(1 << 7)
 346 #define IXGBE_FLAG_RX_PS_ENABLED                (u32)(1 << 8)
 347 #define IXGBE_FLAG_IN_NETPOLL                   (u32)(1 << 9)
 348 #define IXGBE_FLAG_DCA_ENABLED                  (u32)(1 << 10)
 349 #define IXGBE_FLAG_DCA_CAPABLE                  (u32)(1 << 11)
 350 #define IXGBE_FLAG_IMIR_ENABLED                 (u32)(1 << 12)
 351 #define IXGBE_FLAG_MQ_CAPABLE                   (u32)(1 << 13)
 352 #define IXGBE_FLAG_DCB_ENABLED                  (u32)(1 << 14)
 353 #define IXGBE_FLAG_RSS_ENABLED                  (u32)(1 << 16)
 354 #define IXGBE_FLAG_RSS_CAPABLE                  (u32)(1 << 17)
 355 #define IXGBE_FLAG_VMDQ_CAPABLE                 (u32)(1 << 18)
 356 #define IXGBE_FLAG_VMDQ_ENABLED                 (u32)(1 << 19)
 357 #define IXGBE_FLAG_FAN_FAIL_CAPABLE             (u32)(1 << 20)
 358 #define IXGBE_FLAG_NEED_LINK_UPDATE             (u32)(1 << 22)
 359 #define IXGBE_FLAG_IN_SFP_LINK_TASK             (u32)(1 << 23)
 360 #define IXGBE_FLAG_IN_SFP_MOD_TASK              (u32)(1 << 24)
 361 #define IXGBE_FLAG_FDIR_HASH_CAPABLE            (u32)(1 << 25)
 362 #define IXGBE_FLAG_FDIR_PERFECT_CAPABLE         (u32)(1 << 26)
 363 #define IXGBE_FLAG_FCOE_CAPABLE                 (u32)(1 << 27)
 364 #define IXGBE_FLAG_FCOE_ENABLED                 (u32)(1 << 28)
 365 #define IXGBE_FLAG_SRIOV_CAPABLE                (u32)(1 << 29)
 366 #define IXGBE_FLAG_SRIOV_ENABLED                (u32)(1 << 30)
 367
 368         u32 flags2;
 369 #define IXGBE_FLAG2_RSC_CAPABLE                 (u32)(1)
 370 #define IXGBE_FLAG2_RSC_ENABLED                 (u32)(1 << 1)
 371 #define IXGBE_FLAG2_TEMP_SENSOR_CAPABLE         (u32)(1 << 2)
 372 /* default to trying for four seconds */
 373 #define IXGBE_TRY_LINK_TIMEOUT (4 * HZ)
 374
 375         /* OS defined structs */
 376         struct net_device *netdev;
 377         struct pci_dev *pdev;
 378
 379         u32 test_icr;
 380         struct ixgbe_ring test_tx_ring;
 381         struct ixgbe_ring test_rx_ring;
 382
 383         /* structs defined in ixgbe_hw.h */
 384         struct ixgbe_hw hw;
 385         u16 msg_enable;
 386         struct ixgbe_hw_stats stats;
 387
 388         /* Interrupt Throttle Rate */
 389         u32 rx_eitr_param;
 390         u32 tx_eitr_param;
 391
 392         unsigned long state;
 393         u64 tx_busy;
 394         unsigned int tx_ring_count;
 395         unsigned int rx_ring_count;
 396
 397         u32 link_speed;
 398         bool link_up;
 399         unsigned long link_check_timeout;
 400
 401         struct work_struct watchdog_task;
 402         struct work_struct sfp_task;
 403         struct timer_list sfp_timer;
 404         struct work_struct multispeed_fiber_task;
 405         struct work_struct sfp_config_module_task;
 406         u32 fdir_pballoc;
 407         u32 atr_sample_rate;
 408         spinlock_t fdir_perfect_lock;
 409         struct work_struct fdir_reinit_task;
 410 #ifdef IXGBE_FCOE
 411         struct ixgbe_fcoe fcoe;
 412 #endif /* IXGBE_FCOE */
 413         u64 rsc_total_count;
 414         u64 rsc_total_flush;
 415         u32 wol;
 416         u16 eeprom_version;
 417
 418         int node;
 419         struct work_struct check_overtemp_task;
 420         u32 interrupt_event;
 421
 422         /* SR-IOV */
 423         DECLARE_BITMAP(active_vfs, IXGBE_MAX_VF_FUNCTIONS);
 424         unsigned int num_vfs;
 425         struct vf_data_storage *vfinfo;
 426 };
 427
 428 enum ixbge_state_t {
 429         __IXGBE_TESTING,
 430         __IXGBE_RESETTING,
 431         __IXGBE_DOWN,
 432         __IXGBE_FDIR_INIT_DONE,
 433         __IXGBE_SFP_MODULE_NOT_FOUND
 434 };
 435
 436 enum ixgbe_boards {
 437         board_82598,
 438         board_82599,
 439 };
 440
 441 extern struct ixgbe_info ixgbe_82598_info;
 442 extern struct ixgbe_info ixgbe_82599_info;
 443 #ifdef CONFIG_IXGBE_DCB
 444 extern const struct dcbnl_rtnl_ops dcbnl_ops;
 445 extern int ixgbe_copy_dcb_cfg(struct ixgbe_dcb_config *src_dcb_cfg,
 446                               struct ixgbe_dcb_config *dst_dcb_cfg,
 447                               int tc_max);
 448 #endif
 449
 450 extern char ixgbe_driver_name[];
 451 extern const char ixgbe_driver_version[];
 452
 453 extern int ixgbe_up(struct ixgbe_adapter *adapter);
 454 extern void ixgbe_down(struct ixgbe_adapter *adapter);
 455 extern void ixgbe_reinit_locked(struct ixgbe_adapter *adapter);
 456 extern void ixgbe_reset(struct ixgbe_adapter *adapter);
 457 extern void ixgbe_set_ethtool_ops(struct net_device *netdev);
 458 extern int ixgbe_setup_rx_resources(struct ixgbe_ring *);
 459 extern int ixgbe_setup_tx_resources(struct ixgbe_ring *);
 460 extern void ixgbe_free_rx_resources(struct ixgbe_ring *);
 461 extern void ixgbe_free_tx_resources(struct ixgbe_ring *);
 462 extern void ixgbe_configure_rx_ring(struct ixgbe_adapter *,struct ixgbe_ring *);
 463 extern void ixgbe_configure_tx_ring(struct ixgbe_adapter *,struct ixgbe_ring *);
 464 extern void ixgbe_update_stats(struct ixgbe_adapter *adapter);
 465 extern int ixgbe_init_interrupt_scheme(struct ixgbe_adapter *adapter);
 466 extern void ixgbe_clear_interrupt_scheme(struct ixgbe_adapter *adapter);
 467 extern netdev_tx_t ixgbe_xmit_frame_ring(struct sk_buff *,
 468                                          struct net_device *,
 469                                          struct ixgbe_adapter *,
 470                                          struct ixgbe_ring *);
 471 extern void ixgbe_unmap_and_free_tx_resource(struct ixgbe_ring *,
 472                                              struct ixgbe_tx_buffer *);
 473 extern void ixgbe_alloc_rx_buffers(struct ixgbe_adapter *adapter,
 474                                    struct ixgbe_ring *rx_ring,
 475                                    u16 cleaned_count);
 476 extern void ixgbe_write_eitr(struct ixgbe_q_vector *);
 477 extern int ethtool_ioctl(struct ifreq *ifr);
 478 extern s32 ixgbe_reinit_fdir_tables_82599(struct ixgbe_hw *hw);
 479 extern s32 ixgbe_init_fdir_signature_82599(struct ixgbe_hw *hw, u32 pballoc);
 480 extern s32 ixgbe_init_fdir_perfect_82599(struct ixgbe_hw *hw, u32 pballoc);
 481 extern s32 ixgbe_fdir_add_signature_filter_82599(struct ixgbe_hw *hw,
 482                                                  struct ixgbe_atr_input *input,
 483                                                  u8 queue);
 484 extern s32 ixgbe_fdir_add_perfect_filter_82599(struct ixgbe_hw *hw,
 485                                       struct ixgbe_atr_input *input,
 486                                       struct ixgbe_atr_input_masks *input_masks,
 487                                       u16 soft_id, u8 queue);
 488 extern s32 ixgbe_atr_set_vlan_id_82599(struct ixgbe_atr_input *input,
 489                                        u16 vlan_id);
 490 extern s32 ixgbe_atr_set_src_ipv4_82599(struct ixgbe_atr_input *input,
 491                                         u32 src_addr);
 492 extern s32 ixgbe_atr_set_dst_ipv4_82599(struct ixgbe_atr_input *input,
 493                                         u32 dst_addr);
 494 extern s32 ixgbe_atr_set_src_port_82599(struct ixgbe_atr_input *input,
 495                                         u16 src_port);
 496 extern s32 ixgbe_atr_set_dst_port_82599(struct ixgbe_atr_input *input,
 497                                         u16 dst_port);
 498 extern s32 ixgbe_atr_set_flex_byte_82599(struct ixgbe_atr_input *input,
 499                                          u16 flex_byte);
 500 extern s32 ixgbe_atr_set_l4type_82599(struct ixgbe_atr_input *input,
 501                                       u8 l4type);
 502 extern void ixgbe_set_rx_mode(struct net_device *netdev);
 503 #ifdef IXGBE_FCOE
 504 extern void ixgbe_configure_fcoe(struct ixgbe_adapter *adapter);
 505 extern int ixgbe_fso(struct ixgbe_adapter *adapter,
 506                      struct ixgbe_ring *tx_ring, struct sk_buff *skb,
 507                      u32 tx_flags, u8 *hdr_len);
 508 extern void ixgbe_cleanup_fcoe(struct ixgbe_adapter *adapter);
 509 extern int ixgbe_fcoe_ddp(struct ixgbe_adapter *adapter,
 510                           union ixgbe_adv_rx_desc *rx_desc,
 511                           struct sk_buff *skb);
 512 extern int ixgbe_fcoe_ddp_get(struct net_device *netdev, u16 xid,
 513                               struct scatterlist *sgl, unsigned int sgc);
 514 extern int ixgbe_fcoe_ddp_put(struct net_device *netdev, u16 xid);
 515 extern int ixgbe_fcoe_enable(struct net_device *netdev);
 516 extern int ixgbe_fcoe_disable(struct net_device *netdev);
 517 #ifdef CONFIG_IXGBE_DCB
 518 extern u8 ixgbe_fcoe_getapp(struct ixgbe_adapter *adapter);
 519 extern u8 ixgbe_fcoe_setapp(struct ixgbe_adapter *adapter, u8 up);
 520 #endif /* CONFIG_IXGBE_DCB */
 521 extern int ixgbe_fcoe_get_wwn(struct net_device *netdev, u64 *wwn, int type);
 522 #endif /* IXGBE_FCOE */
 523
 524 #endif /* _IXGBE_H_ */