drivers/gpu/drm/nouveau/nouveau_drv.h

   1 /*
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  23  */
  24
  25 #ifndef __NOUVEAU_DRV_H__
  26 #define __NOUVEAU_DRV_H__
  27
  28 #define DRIVER_AUTHOR           "Stephane Marchesin"
  29 #define DRIVER_EMAIL            "dri-devel@lists.sourceforge.net"
  30
  31 #define DRIVER_NAME             "nouveau"
  32 #define DRIVER_DESC             "nVidia Riva/TNT/GeForce"
  33 #define DRIVER_DATE             "20090420"
  34
  35 #define DRIVER_MAJOR            0
  36 #define DRIVER_MINOR            0
  37 #define DRIVER_PATCHLEVEL       16
  38
  39 #define NOUVEAU_FAMILY   0x0000FFFF
  40 #define NOUVEAU_FLAGS    0xFFFF0000
  41
  42 #include "ttm/ttm_bo_api.h"
  43 #include "ttm/ttm_bo_driver.h"
  44 #include "ttm/ttm_placement.h"
  45 #include "ttm/ttm_memory.h"
  46 #include "ttm/ttm_module.h"
  47
  48 struct nouveau_fpriv {
  49         struct ttm_object_file *tfile;
  50 };
  51
  52 #define DRM_FILE_PAGE_OFFSET (0x100000000ULL >> PAGE_SHIFT)
  53
  54 #include "nouveau_drm.h"
  55 #include "nouveau_reg.h"
  56 #include "nouveau_bios.h"
  57 struct nouveau_grctx;
  58
  59 #define MAX_NUM_DCB_ENTRIES 16
  60
  61 #define NOUVEAU_MAX_CHANNEL_NR 128
  62 #define NOUVEAU_MAX_TILE_NR 15
  63
  64 #define NV50_VM_MAX_VRAM (2*1024*1024*1024ULL)
  65 #define NV50_VM_BLOCK    (512*1024*1024ULL)
  66 #define NV50_VM_VRAM_NR  (NV50_VM_MAX_VRAM / NV50_VM_BLOCK)
  67
  68 struct nouveau_tile_reg {
  69         struct nouveau_fence *fence;
  70         uint32_t addr;
  71         uint32_t size;
  72         bool used;
  73 };
  74
  75 struct nouveau_bo {
  76         struct ttm_buffer_object bo;
  77         struct ttm_placement placement;
  78         u32 placements[3];
  79         struct ttm_bo_kmap_obj kmap;
  80         struct list_head head;
  81
  82         /* protected by ttm_bo_reserve() */
  83         struct drm_file *reserved_by;
  84         struct list_head entry;
  85         int pbbo_index;
  86         bool validate_mapped;
  87
  88         struct nouveau_channel *channel;
  89
  90         bool mappable;
  91         bool no_vm;
  92
  93         uint32_t tile_mode;
  94         uint32_t tile_flags;
  95         struct nouveau_tile_reg *tile;
  96
  97         struct drm_gem_object *gem;
  98         struct drm_file *cpu_filp;
  99         int pin_refcnt;
 100 };
 101
 102 static inline struct nouveau_bo *
 103 nouveau_bo(struct ttm_buffer_object *bo)
 104 {
 105         return container_of(bo, struct nouveau_bo, bo);
 106 }
 107
 108 static inline struct nouveau_bo *
 109 nouveau_gem_object(struct drm_gem_object *gem)
 110 {
 111         return gem ? gem->driver_private : NULL;
 112 }
 113
 114 /* TODO: submit equivalent to TTM generic API upstream? */
 115 static inline void __iomem *
 116 nvbo_kmap_obj_iovirtual(struct nouveau_bo *nvbo)
 117 {
 118         bool is_iomem;
 119         void __iomem *ioptr = (void __force __iomem *)ttm_kmap_obj_virtual(
 120                                                 &nvbo->kmap, &is_iomem);
 121         WARN_ON_ONCE(ioptr && !is_iomem);
 122         return ioptr;
 123 }
 124
 125 struct mem_block {
 126         struct mem_block *next;
 127         struct mem_block *prev;
 128         uint64_t start;
 129         uint64_t size;
 130         struct drm_file *file_priv; /* NULL: free, -1: heap, other: real files */
 131 };
 132
 133 enum nouveau_flags {
 134         NV_NFORCE   = 0x10000000,
 135         NV_NFORCE2  = 0x20000000
 136 };
 137
 138 #define NVOBJ_ENGINE_SW         0
 139 #define NVOBJ_ENGINE_GR         1
 140 #define NVOBJ_ENGINE_DISPLAY    2
 141 #define NVOBJ_ENGINE_INT        0xdeadbeef
 142
 143 #define NVOBJ_FLAG_ALLOW_NO_REFS        (1 << 0)
 144 #define NVOBJ_FLAG_ZERO_ALLOC           (1 << 1)
 145 #define NVOBJ_FLAG_ZERO_FREE            (1 << 2)
 146 #define NVOBJ_FLAG_FAKE                 (1 << 3)
 147 struct nouveau_gpuobj {
 148         struct list_head list;
 149
 150         struct nouveau_channel *im_channel;
 151         struct mem_block *im_pramin;
 152         struct nouveau_bo *im_backing;
 153         uint32_t im_backing_start;
 154         uint32_t *im_backing_suspend;
 155         int im_bound;
 156
 157         uint32_t flags;
 158         int refcount;
 159
 160         uint32_t engine;
 161         uint32_t class;
 162
 163         void (*dtor)(struct drm_device *, struct nouveau_gpuobj *);
 164         void *priv;
 165 };
 166
 167 struct nouveau_gpuobj_ref {
 168         struct list_head list;
 169
 170         struct nouveau_gpuobj *gpuobj;
 171         uint32_t instance;
 172
 173         struct nouveau_channel *channel;
 174         int handle;
 175 };
 176
 177 struct nouveau_channel {
 178         struct drm_device *dev;
 179         int id;
 180
 181         /* owner of this fifo */
 182         struct drm_file *file_priv;
 183         /* mapping of the fifo itself */
 184         struct drm_local_map *map;
 185
 186         /* mapping of the regs controling the fifo */
 187         void __iomem *user;
 188         uint32_t user_get;
 189         uint32_t user_put;
 190
 191         /* Fencing */
 192         struct {
 193                 /* lock protects the pending list only */
 194                 spinlock_t lock;
 195                 struct list_head pending;
 196                 uint32_t sequence;
 197                 uint32_t sequence_ack;
 198                 uint32_t last_sequence_irq;
 199         } fence;
 200
 201         /* DMA push buffer */
 202         struct nouveau_gpuobj_ref *pushbuf;
 203         struct nouveau_bo         *pushbuf_bo;
 204         uint32_t                   pushbuf_base;
 205
 206         /* Notifier memory */
 207         struct nouveau_bo *notifier_bo;
 208         struct mem_block *notifier_heap;
 209
 210         /* PFIFO context */
 211         struct nouveau_gpuobj_ref *ramfc;
 212         struct nouveau_gpuobj_ref *cache;
 213
 214         /* PGRAPH context */
 215         /* XXX may be merge 2 pointers as private data ??? */
 216         struct nouveau_gpuobj_ref *ramin_grctx;
 217         void *pgraph_ctx;
 218
 219         /* NV50 VM */
 220         struct nouveau_gpuobj     *vm_pd;
 221         struct nouveau_gpuobj_ref *vm_gart_pt;
 222         struct nouveau_gpuobj_ref *vm_vram_pt[NV50_VM_VRAM_NR];
 223
 224         /* Objects */
 225         struct nouveau_gpuobj_ref *ramin; /* Private instmem */
 226         struct mem_block          *ramin_heap; /* Private PRAMIN heap */
 227         struct nouveau_gpuobj_ref *ramht; /* Hash table */
 228         struct list_head           ramht_refs; /* Objects referenced by RAMHT */
 229
 230         /* GPU object info for stuff used in-kernel (mm_enabled) */
 231         uint32_t m2mf_ntfy;
 232         uint32_t vram_handle;
 233         uint32_t gart_handle;
 234         bool accel_done;
 235
 236         /* Push buffer state (only for drm's channel on !mm_enabled) */
 237         struct {
 238                 int max;
 239                 int free;
 240                 int cur;
 241                 int put;
 242                 /* access via pushbuf_bo */
 243
 244                 int ib_base;
 245                 int ib_max;
 246                 int ib_free;
 247                 int ib_put;
 248         } dma;
 249
 250         uint32_t sw_subchannel[8];
 251
 252         struct {
 253                 struct nouveau_gpuobj *vblsem;
 254                 uint32_t vblsem_offset;
 255                 uint32_t vblsem_rval;
 256                 struct list_head vbl_wait;
 257         } nvsw;
 258
 259         struct {
 260                 bool active;
 261                 char name[32];
 262                 struct drm_info_list info;
 263         } debugfs;
 264 };
 265
 266 struct nouveau_instmem_engine {
 267         void    *priv;
 268
 269         int     (*init)(struct drm_device *dev);
 270         void    (*takedown)(struct drm_device *dev);
 271         int     (*suspend)(struct drm_device *dev);
 272         void    (*resume)(struct drm_device *dev);
 273
 274         int     (*populate)(struct drm_device *, struct nouveau_gpuobj *,
 275                             uint32_t *size);
 276         void    (*clear)(struct drm_device *, struct nouveau_gpuobj *);
 277         int     (*bind)(struct drm_device *, struct nouveau_gpuobj *);
 278         int     (*unbind)(struct drm_device *, struct nouveau_gpuobj *);
 279         void    (*prepare_access)(struct drm_device *, bool write);
 280         void    (*finish_access)(struct drm_device *);
 281 };
 282
 283 struct nouveau_mc_engine {
 284         int  (*init)(struct drm_device *dev);
 285         void (*takedown)(struct drm_device *dev);
 286 };
 287
 288 struct nouveau_timer_engine {
 289         int      (*init)(struct drm_device *dev);
 290         void     (*takedown)(struct drm_device *dev);
 291         uint64_t (*read)(struct drm_device *dev);
 292 };
 293
 294 struct nouveau_fb_engine {
 295         int num_tiles;
 296
 297         int  (*init)(struct drm_device *dev);
 298         void (*takedown)(struct drm_device *dev);
 299
 300         void (*set_region_tiling)(struct drm_device *dev, int i, uint32_t addr,
 301                                  uint32_t size, uint32_t pitch);
 302 };
 303
 304 struct nouveau_fifo_engine {
 305         void *priv;
 306
 307         int  channels;
 308
 309         int  (*init)(struct drm_device *);
 310         void (*takedown)(struct drm_device *);
 311
 312         void (*disable)(struct drm_device *);
 313         void (*enable)(struct drm_device *);
 314         bool (*reassign)(struct drm_device *, bool enable);
 315         bool (*cache_flush)(struct drm_device *dev);
 316         bool (*cache_pull)(struct drm_device *dev, bool enable);
 317
 318         int  (*channel_id)(struct drm_device *);
 319
 320         int  (*create_context)(struct nouveau_channel *);
 321         void (*destroy_context)(struct nouveau_channel *);
 322         int  (*load_context)(struct nouveau_channel *);
 323         int  (*unload_context)(struct drm_device *);
 324 };
 325
 326 struct nouveau_pgraph_object_method {
 327         int id;
 328         int (*exec)(struct nouveau_channel *chan, int grclass, int mthd,
 329                       uint32_t data);
 330 };
 331
 332 struct nouveau_pgraph_object_class {
 333         int id;
 334         bool software;
 335         struct nouveau_pgraph_object_method *methods;
 336 };
 337
 338 struct nouveau_pgraph_engine {
 339         struct nouveau_pgraph_object_class *grclass;
 340         bool accel_blocked;
 341         void *ctxprog;
 342         void *ctxvals;
 343         int grctx_size;
 344
 345         int  (*init)(struct drm_device *);
 346         void (*takedown)(struct drm_device *);
 347
 348         void (*fifo_access)(struct drm_device *, bool);
 349
 350         struct nouveau_channel *(*channel)(struct drm_device *);
 351         int  (*create_context)(struct nouveau_channel *);
 352         void (*destroy_context)(struct nouveau_channel *);
 353         int  (*load_context)(struct nouveau_channel *);
 354         int  (*unload_context)(struct drm_device *);
 355
 356         void (*set_region_tiling)(struct drm_device *dev, int i, uint32_t addr,
 357                                   uint32_t size, uint32_t pitch);
 358 };
 359
 360 struct nouveau_engine {
 361         struct nouveau_instmem_engine instmem;
 362         struct nouveau_mc_engine      mc;
 363         struct nouveau_timer_engine   timer;
 364         struct nouveau_fb_engine      fb;
 365         struct nouveau_pgraph_engine  graph;
 366         struct nouveau_fifo_engine    fifo;
 367 };
 368
 369 struct nouveau_pll_vals {
 370         union {
 371                 struct {
 372 #ifdef __BIG_ENDIAN
 373                         uint8_t N1, M1, N2, M2;
 374 #else
 375                         uint8_t M1, N1, M2, N2;
 376 #endif
 377                 };
 378                 struct {
 379                         uint16_t NM1, NM2;
 380                 } __attribute__((packed));
 381         };
 382         int log2P;
 383
 384         int refclk;
 385 };
 386
 387 enum nv04_fp_display_regs {
 388         FP_DISPLAY_END,
 389         FP_TOTAL,
 390         FP_CRTC,
 391         FP_SYNC_START,
 392         FP_SYNC_END,
 393         FP_VALID_START,
 394         FP_VALID_END
 395 };
 396
 397 struct nv04_crtc_reg {
 398         unsigned char MiscOutReg;     /* */
 399         uint8_t CRTC[0x9f];
 400         uint8_t CR58[0x10];
 401         uint8_t Sequencer[5];
 402         uint8_t Graphics[9];
 403         uint8_t Attribute[21];
 404         unsigned char DAC[768];       /* Internal Colorlookuptable */
 405
 406         /* PCRTC regs */
 407         uint32_t fb_start;
 408         uint32_t crtc_cfg;
 409         uint32_t cursor_cfg;
 410         uint32_t gpio_ext;
 411         uint32_t crtc_830;
 412         uint32_t crtc_834;
 413         uint32_t crtc_850;
 414         uint32_t crtc_eng_ctrl;
 415
 416         /* PRAMDAC regs */
 417         uint32_t nv10_cursync;
 418         struct nouveau_pll_vals pllvals;
 419         uint32_t ramdac_gen_ctrl;
 420         uint32_t ramdac_630;
 421         uint32_t ramdac_634;
 422         uint32_t tv_setup;
 423         uint32_t tv_vtotal;
 424         uint32_t tv_vskew;
 425         uint32_t tv_vsync_delay;
 426         uint32_t tv_htotal;
 427         uint32_t tv_hskew;
 428         uint32_t tv_hsync_delay;
 429         uint32_t tv_hsync_delay2;
 430         uint32_t fp_horiz_regs[7];
 431         uint32_t fp_vert_regs[7];
 432         uint32_t dither;
 433         uint32_t fp_control;
 434         uint32_t dither_regs[6];
 435         uint32_t fp_debug_0;
 436         uint32_t fp_debug_1;
 437         uint32_t fp_debug_2;
 438         uint32_t fp_margin_color;
 439         uint32_t ramdac_8c0;
 440         uint32_t ramdac_a20;
 441         uint32_t ramdac_a24;
 442         uint32_t ramdac_a34;
 443         uint32_t ctv_regs[38];
 444 };
 445
 446 struct nv04_output_reg {
 447         uint32_t output;
 448         int head;
 449 };
 450
 451 struct nv04_mode_state {
 452         uint32_t bpp;
 453         uint32_t width;
 454         uint32_t height;
 455         uint32_t interlace;
 456         uint32_t repaint0;
 457         uint32_t repaint1;
 458         uint32_t screen;
 459         uint32_t scale;
 460         uint32_t dither;
 461         uint32_t extra;
 462         uint32_t fifo;
 463         uint32_t pixel;
 464         uint32_t horiz;
 465         int arbitration0;
 466         int arbitration1;
 467         uint32_t pll;
 468         uint32_t pllB;
 469         uint32_t vpll;
 470         uint32_t vpll2;
 471         uint32_t vpllB;
 472         uint32_t vpll2B;
 473         uint32_t pllsel;
 474         uint32_t sel_clk;
 475         uint32_t general;
 476         uint32_t crtcOwner;
 477         uint32_t head;
 478         uint32_t head2;
 479         uint32_t cursorConfig;
 480         uint32_t cursor0;
 481         uint32_t cursor1;
 482         uint32_t cursor2;
 483         uint32_t timingH;
 484         uint32_t timingV;
 485         uint32_t displayV;
 486         uint32_t crtcSync;
 487
 488         struct nv04_crtc_reg crtc_reg[2];
 489 };
 490
 491 enum nouveau_card_type {
 492         NV_04      = 0x00,
 493         NV_10      = 0x10,
 494         NV_20      = 0x20,
 495         NV_30      = 0x30,
 496         NV_40      = 0x40,
 497         NV_50      = 0x50,
 498 };
 499
 500 struct drm_nouveau_private {
 501         struct drm_device *dev;
 502         enum {
 503                 NOUVEAU_CARD_INIT_DOWN,
 504                 NOUVEAU_CARD_INIT_DONE,
 505                 NOUVEAU_CARD_INIT_FAILED
 506         } init_state;
 507
 508         /* the card type, takes NV_* as values */
 509         enum nouveau_card_type card_type;
 510         /* exact chipset, derived from NV_PMC_BOOT_0 */
 511         int chipset;
 512         int flags;
 513
 514         void __iomem *mmio;
 515         void __iomem *ramin;
 516         uint32_t ramin_size;
 517
 518         struct nouveau_bo *vga_ram;
 519
 520         struct workqueue_struct *wq;
 521         struct work_struct irq_work;
 522
 523         struct list_head vbl_waiting;
 524
 525         struct {
 526                 struct ttm_global_reference mem_global_ref;
 527                 struct ttm_bo_global_ref bo_global_ref;
 528                 struct ttm_bo_device bdev;
 529                 spinlock_t bo_list_lock;
 530                 struct list_head bo_list;
 531                 atomic_t validate_sequence;
 532         } ttm;
 533
 534         struct fb_info *fbdev_info;
 535
 536         int fifo_alloc_count;
 537         struct nouveau_channel *fifos[NOUVEAU_MAX_CHANNEL_NR];
 538
 539         struct nouveau_engine engine;
 540         struct nouveau_channel *channel;
 541
 542         /* For PFIFO and PGRAPH. */
 543         spinlock_t context_switch_lock;
 544
 545         /* RAMIN configuration, RAMFC, RAMHT and RAMRO offsets */
 546         struct nouveau_gpuobj *ramht;
 547         uint32_t ramin_rsvd_vram;
 548         uint32_t ramht_offset;
 549         uint32_t ramht_size;
 550         uint32_t ramht_bits;
 551         uint32_t ramfc_offset;
 552         uint32_t ramfc_size;
 553         uint32_t ramro_offset;
 554         uint32_t ramro_size;
 555
 556         /* base physical adresses */
 557         uint64_t fb_phys;
 558         uint64_t fb_available_size;
 559         uint64_t fb_mappable_pages;
 560         uint64_t fb_aper_free;
 561
 562         struct {
 563                 enum {
 564                         NOUVEAU_GART_NONE = 0,
 565                         NOUVEAU_GART_AGP,
 566                         NOUVEAU_GART_SGDMA
 567                 } type;
 568                 uint64_t aper_base;
 569                 uint64_t aper_size;
 570                 uint64_t aper_free;
 571
 572                 struct nouveau_gpuobj *sg_ctxdma;
 573                 struct page *sg_dummy_page;
 574                 dma_addr_t sg_dummy_bus;
 575
 576                 /* nottm hack */
 577                 struct drm_ttm_backend *sg_be;
 578                 unsigned long sg_handle;
 579         } gart_info;
 580
 581         /* nv10-nv40 tiling regions */
 582         struct {
 583                 struct nouveau_tile_reg reg[NOUVEAU_MAX_TILE_NR];
 584                 spinlock_t lock;
 585         } tile;
 586
 587         /* G8x/G9x virtual address space */
 588         uint64_t vm_gart_base;
 589         uint64_t vm_gart_size;
 590         uint64_t vm_vram_base;
 591         uint64_t vm_vram_size;
 592         uint64_t vm_end;
 593         struct nouveau_gpuobj *vm_vram_pt[NV50_VM_VRAM_NR];
 594         int vm_vram_pt_nr;
 595         uint64_t vram_sys_base;
 596
 597         /* the mtrr covering the FB */
 598         int fb_mtrr;
 599
 600         struct mem_block *ramin_heap;
 601
 602         /* context table pointed to be NV_PGRAPH_CHANNEL_CTX_TABLE (0x400780) */
 603         uint32_t ctx_table_size;
 604         struct nouveau_gpuobj_ref *ctx_table;
 605
 606         struct list_head gpuobj_list;
 607
 608         struct nvbios vbios;
 609
 610         struct nv04_mode_state mode_reg;
 611         struct nv04_mode_state saved_reg;
 612         uint32_t saved_vga_font[4][16384];
 613         uint32_t crtc_owner;
 614         uint32_t dac_users[4];
 615
 616         struct nouveau_suspend_resume {
 617                 uint32_t fifo_mode;
 618                 uint32_t graph_ctx_control;
 619                 uint32_t graph_state;
 620                 uint32_t *ramin_copy;
 621                 uint64_t ramin_size;
 622         } susres;
 623
 624         struct backlight_device *backlight;
 625         bool acpi_dsm;
 626
 627         struct nouveau_channel *evo;
 628
 629         struct {
 630                 struct dentry *channel_root;
 631         } debugfs;
 632 };
 633
 634 static inline struct drm_nouveau_private *
 635 nouveau_bdev(struct ttm_bo_device *bd)
 636 {
 637         return container_of(bd, struct drm_nouveau_private, ttm.bdev);
 638 }
 639
 640 static inline int
 641 nouveau_bo_ref(struct nouveau_bo *ref, struct nouveau_bo **pnvbo)
 642 {
 643         struct nouveau_bo *prev;
 644
 645         if (!pnvbo)
 646                 return -EINVAL;
 647         prev = *pnvbo;
 648
 649         *pnvbo = ref ? nouveau_bo(ttm_bo_reference(&ref->bo)) : NULL;
 650         if (prev) {
 651                 struct ttm_buffer_object *bo = &prev->bo;
 652
 653                 ttm_bo_unref(&bo);
 654         }
 655
 656         return 0;
 657 }
 658
 659 #define NOUVEAU_CHECK_INITIALISED_WITH_RETURN do {            \
 660         struct drm_nouveau_private *nv = dev->dev_private;    \
 661         if (nv->init_state != NOUVEAU_CARD_INIT_DONE) {       \
 662                 NV_ERROR(dev, "called without init\n");       \
 663                 return -EINVAL;                               \
 664         }                                                     \
 665 } while (0)
 666
 667 #define NOUVEAU_GET_USER_CHANNEL_WITH_RETURN(id, cl, ch) do {    \
 668         struct drm_nouveau_private *nv = dev->dev_private;       \
 669         if (!nouveau_channel_owner(dev, (cl), (id))) {           \
 670                 NV_ERROR(dev, "pid %d doesn't own channel %d\n", \
 671                          DRM_CURRENTPID, (id));                  \
 672                 return -EPERM;                                   \
 673         }                                                        \
 674         (ch) = nv->fifos[(id)];                                  \
 675 } while (0)
 676
 677 /* nouveau_drv.c */
 678 extern int nouveau_noagp;
 679 extern int nouveau_duallink;
 680 extern int nouveau_uscript_lvds;
 681 extern int nouveau_uscript_tmds;
 682 extern int nouveau_vram_pushbuf;
 683 extern int nouveau_vram_notify;
 684 extern int nouveau_fbpercrtc;
 685 extern int nouveau_tv_disable;
 686 extern char *nouveau_tv_norm;
 687 extern int nouveau_reg_debug;
 688 extern char *nouveau_vbios;
 689 extern int nouveau_ctxfw;
 690 extern int nouveau_ignorelid;
 691 extern int nouveau_nofbaccel;
 692 extern int nouveau_noaccel;
 693 extern int nouveau_override_conntype;
 694
 695 /* nouveau_state.c */
 696 extern void nouveau_preclose(struct drm_device *dev, struct drm_file *);
 697 extern int  nouveau_load(struct drm_device *, unsigned long flags);
 698 extern int  nouveau_firstopen(struct drm_device *);
 699 extern void nouveau_lastclose(struct drm_device *);
 700 extern int  nouveau_unload(struct drm_device *);
 701 extern int  nouveau_ioctl_getparam(struct drm_device *, void *data,
 702                                    struct drm_file *);
 703 extern int  nouveau_ioctl_setparam(struct drm_device *, void *data,
 704                                    struct drm_file *);
 705 extern bool nouveau_wait_until(struct drm_device *, uint64_t timeout,
 706                                uint32_t reg, uint32_t mask, uint32_t val);
 707 extern bool nouveau_wait_for_idle(struct drm_device *);
 708 extern int  nouveau_card_init(struct drm_device *);
 709
 710 /* nouveau_mem.c */
 711 extern int  nouveau_mem_init_heap(struct mem_block **, uint64_t start,
 712                                  uint64_t size);
 713 extern struct mem_block *nouveau_mem_alloc_block(struct mem_block *,
 714                                                  uint64_t size, int align2,
 715                                                  struct drm_file *, int tail);
 716 extern void nouveau_mem_takedown(struct mem_block **heap);
 717 extern void nouveau_mem_free_block(struct mem_block *);
 718 extern uint64_t nouveau_mem_fb_amount(struct drm_device *);
 719 extern void nouveau_mem_release(struct drm_file *, struct mem_block *heap);
 720 extern int  nouveau_mem_init(struct drm_device *);
 721 extern int  nouveau_mem_init_agp(struct drm_device *);
 722 extern void nouveau_mem_close(struct drm_device *);
 723 extern struct nouveau_tile_reg *nv10_mem_set_tiling(struct drm_device *dev,
 724                                                     uint32_t addr,
 725                                                     uint32_t size,
 726                                                     uint32_t pitch);
 727 extern void nv10_mem_expire_tiling(struct drm_device *dev,
 728                                    struct nouveau_tile_reg *tile,
 729                                    struct nouveau_fence *fence);
 730 extern int  nv50_mem_vm_bind_linear(struct drm_device *, uint64_t virt,
 731                                     uint32_t size, uint32_t flags,
 732                                     uint64_t phys);
 733 extern void nv50_mem_vm_unbind(struct drm_device *, uint64_t virt,
 734                                uint32_t size);
 735
 736 /* nouveau_notifier.c */
 737 extern int  nouveau_notifier_init_channel(struct nouveau_channel *);
 738 extern void nouveau_notifier_takedown_channel(struct nouveau_channel *);
 739 extern int  nouveau_notifier_alloc(struct nouveau_channel *, uint32_t handle,
 740                                    int cout, uint32_t *offset);
 741 extern int  nouveau_notifier_offset(struct nouveau_gpuobj *, uint32_t *);
 742 extern int  nouveau_ioctl_notifier_alloc(struct drm_device *, void *data,
 743                                          struct drm_file *);
 744 extern int  nouveau_ioctl_notifier_free(struct drm_device *, void *data,
 745                                         struct drm_file *);
 746
 747 /* nouveau_channel.c */
 748 extern struct drm_ioctl_desc nouveau_ioctls[];
 749 extern int nouveau_max_ioctl;
 750 extern void nouveau_channel_cleanup(struct drm_device *, struct drm_file *);
 751 extern int  nouveau_channel_owner(struct drm_device *, struct drm_file *,
 752                                   int channel);
 753 extern int  nouveau_channel_alloc(struct drm_device *dev,
 754                                   struct nouveau_channel **chan,
 755                                   struct drm_file *file_priv,
 756                                   uint32_t fb_ctxdma, uint32_t tt_ctxdma);
 757 extern void nouveau_channel_free(struct nouveau_channel *);
 758
 759 /* nouveau_object.c */
 760 extern int  nouveau_gpuobj_early_init(struct drm_device *);
 761 extern int  nouveau_gpuobj_init(struct drm_device *);
 762 extern void nouveau_gpuobj_takedown(struct drm_device *);
 763 extern void nouveau_gpuobj_late_takedown(struct drm_device *);
 764 extern int  nouveau_gpuobj_suspend(struct drm_device *dev);
 765 extern void nouveau_gpuobj_suspend_cleanup(struct drm_device *dev);
 766 extern void nouveau_gpuobj_resume(struct drm_device *dev);
 767 extern int nouveau_gpuobj_channel_init(struct nouveau_channel *,
 768                                        uint32_t vram_h, uint32_t tt_h);
 769 extern void nouveau_gpuobj_channel_takedown(struct nouveau_channel *);
 770 extern int nouveau_gpuobj_new(struct drm_device *, struct nouveau_channel *,
 771                               uint32_t size, int align, uint32_t flags,
 772                               struct nouveau_gpuobj **);
 773 extern int nouveau_gpuobj_del(struct drm_device *, struct nouveau_gpuobj **);
 774 extern int nouveau_gpuobj_ref_add(struct drm_device *, struct nouveau_channel *,
 775                                   uint32_t handle, struct nouveau_gpuobj *,
 776                                   struct nouveau_gpuobj_ref **);
 777 extern int nouveau_gpuobj_ref_del(struct drm_device *,
 778                                   struct nouveau_gpuobj_ref **);
 779 extern int nouveau_gpuobj_ref_find(struct nouveau_channel *, uint32_t handle,
 780                                    struct nouveau_gpuobj_ref **ref_ret);
 781 extern int nouveau_gpuobj_new_ref(struct drm_device *,
 782                                   struct nouveau_channel *alloc_chan,
 783                                   struct nouveau_channel *ref_chan,
 784                                   uint32_t handle, uint32_t size, int align,
 785                                   uint32_t flags, struct nouveau_gpuobj_ref **);
 786 extern int nouveau_gpuobj_new_fake(struct drm_device *,
 787                                    uint32_t p_offset, uint32_t b_offset,
 788                                    uint32_t size, uint32_t flags,
 789                                    struct nouveau_gpuobj **,
 790                                    struct nouveau_gpuobj_ref**);
 791 extern int nouveau_gpuobj_dma_new(struct nouveau_channel *, int class,
 792                                   uint64_t offset, uint64_t size, int access,
 793                                   int target, struct nouveau_gpuobj **);
 794 extern int nouveau_gpuobj_gart_dma_new(struct nouveau_channel *,
 795                                        uint64_t offset, uint64_t size,
 796                                        int access, struct nouveau_gpuobj **,
 797                                        uint32_t *o_ret);
 798 extern int nouveau_gpuobj_gr_new(struct nouveau_channel *, int class,
 799                                  struct nouveau_gpuobj **);
 800 extern int nouveau_gpuobj_sw_new(struct nouveau_channel *, int class,
 801                                  struct nouveau_gpuobj **);
 802 extern int nouveau_ioctl_grobj_alloc(struct drm_device *, void *data,
 803                                      struct drm_file *);
 804 extern int nouveau_ioctl_gpuobj_free(struct drm_device *, void *data,
 805                                      struct drm_file *);
 806
 807 /* nouveau_irq.c */
 808 extern irqreturn_t nouveau_irq_handler(DRM_IRQ_ARGS);
 809 extern void        nouveau_irq_preinstall(struct drm_device *);
 810 extern int         nouveau_irq_postinstall(struct drm_device *);
 811 extern void        nouveau_irq_uninstall(struct drm_device *);
 812
 813 /* nouveau_sgdma.c */
 814 extern int nouveau_sgdma_init(struct drm_device *);
 815 extern void nouveau_sgdma_takedown(struct drm_device *);
 816 extern int nouveau_sgdma_get_page(struct drm_device *, uint32_t offset,
 817                                   uint32_t *page);
 818 extern struct ttm_backend *nouveau_sgdma_init_ttm(struct drm_device *);
 819
 820 /* nouveau_debugfs.c */
 821 #if defined(CONFIG_DRM_NOUVEAU_DEBUG)
 822 extern int  nouveau_debugfs_init(struct drm_minor *);
 823 extern void nouveau_debugfs_takedown(struct drm_minor *);
 824 extern int  nouveau_debugfs_channel_init(struct nouveau_channel *);
 825 extern void nouveau_debugfs_channel_fini(struct nouveau_channel *);
 826 #else
 827 static inline int
 828 nouveau_debugfs_init(struct drm_minor *minor)
 829 {
 830         return 0;
 831 }
 832
 833 static inline void nouveau_debugfs_takedown(struct drm_minor *minor)
 834 {
 835 }
 836
 837 static inline int
 838 nouveau_debugfs_channel_init(struct nouveau_channel *chan)
 839 {
 840         return 0;
 841 }
 842
 843 static inline void
 844 nouveau_debugfs_channel_fini(struct nouveau_channel *chan)
 845 {
 846 }
 847 #endif
 848
 849 /* nouveau_dma.c */
 850 extern void nouveau_dma_pre_init(struct nouveau_channel *);
 851 extern int  nouveau_dma_init(struct nouveau_channel *);
 852 extern int  nouveau_dma_wait(struct nouveau_channel *, int slots, int size);
 853
 854 /* nouveau_acpi.c */
 855 #ifdef CONFIG_ACPI
 856 extern int nouveau_hybrid_setup(struct drm_device *dev);
 857 extern bool nouveau_dsm_probe(struct drm_device *dev);
 858 #else
 859 static inline int nouveau_hybrid_setup(struct drm_device *dev)
 860 {
 861         return 0;
 862 }
 863 static inline bool nouveau_dsm_probe(struct drm_device *dev)
 864 {
 865         return false;
 866 }
 867 #endif
 868
 869 /* nouveau_backlight.c */
 870 #ifdef CONFIG_DRM_NOUVEAU_BACKLIGHT
 871 extern int nouveau_backlight_init(struct drm_device *);
 872 extern void nouveau_backlight_exit(struct drm_device *);
 873 #else
 874 static inline int nouveau_backlight_init(struct drm_device *dev)
 875 {
 876         return 0;
 877 }
 878
 879 static inline void nouveau_backlight_exit(struct drm_device *dev) { }
 880 #endif
 881
 882 /* nouveau_bios.c */
 883 extern int nouveau_bios_init(struct drm_device *);
 884 extern void nouveau_bios_takedown(struct drm_device *dev);
 885 extern int nouveau_run_vbios_init(struct drm_device *);
 886 extern void nouveau_bios_run_init_table(struct drm_device *, uint16_t table,
 887                                         struct dcb_entry *);
 888 extern struct dcb_gpio_entry *nouveau_bios_gpio_entry(struct drm_device *,
 889                                                       enum dcb_gpio_tag);
 890 extern struct dcb_connector_table_entry *
 891 nouveau_bios_connector_entry(struct drm_device *, int index);
 892 extern int get_pll_limits(struct drm_device *, uint32_t limit_match,
 893                           struct pll_lims *);
 894 extern int nouveau_bios_run_display_table(struct drm_device *,
 895                                           struct dcb_entry *,
 896                                           uint32_t script, int pxclk);
 897 extern void *nouveau_bios_dp_table(struct drm_device *, struct dcb_entry *,
 898                                    int *length);
 899 extern bool nouveau_bios_fp_mode(struct drm_device *, struct drm_display_mode *);
 900 extern uint8_t *nouveau_bios_embedded_edid(struct drm_device *);
 901 extern int nouveau_bios_parse_lvds_table(struct drm_device *, int pxclk,
 902                                          bool *dl, bool *if_is_24bit);
 903 extern int run_tmds_table(struct drm_device *, struct dcb_entry *,
 904                           int head, int pxclk);
 905 extern int call_lvds_script(struct drm_device *, struct dcb_entry *, int head,
 906                             enum LVDS_script, int pxclk);
 907
 908 /* nouveau_ttm.c */
 909 int nouveau_ttm_global_init(struct drm_nouveau_private *);
 910 void nouveau_ttm_global_release(struct drm_nouveau_private *);
 911 int nouveau_ttm_mmap(struct file *, struct vm_area_struct *);
 912
 913 /* nouveau_dp.c */
 914 int nouveau_dp_auxch(struct nouveau_i2c_chan *auxch, int cmd, int addr,
 915                      uint8_t *data, int data_nr);
 916 bool nouveau_dp_detect(struct drm_encoder *);
 917 bool nouveau_dp_link_train(struct drm_encoder *);
 918
 919 /* nv04_fb.c */
 920 extern int  nv04_fb_init(struct drm_device *);
 921 extern void nv04_fb_takedown(struct drm_device *);
 922
 923 /* nv10_fb.c */
 924 extern int  nv10_fb_init(struct drm_device *);
 925 extern void nv10_fb_takedown(struct drm_device *);
 926 extern void nv10_fb_set_region_tiling(struct drm_device *, int, uint32_t,
 927                                       uint32_t, uint32_t);
 928
 929 /* nv40_fb.c */
 930 extern int  nv40_fb_init(struct drm_device *);
 931 extern void nv40_fb_takedown(struct drm_device *);
 932 extern void nv40_fb_set_region_tiling(struct drm_device *, int, uint32_t,
 933                                       uint32_t, uint32_t);
 934
 935 /* nv50_fb.c */
 936 extern int  nv50_fb_init(struct drm_device *);
 937 extern void nv50_fb_takedown(struct drm_device *);
 938
 939 /* nv04_fifo.c */
 940 extern int  nv04_fifo_init(struct drm_device *);
 941 extern void nv04_fifo_disable(struct drm_device *);
 942 extern void nv04_fifo_enable(struct drm_device *);
 943 extern bool nv04_fifo_reassign(struct drm_device *, bool);
 944 extern bool nv04_fifo_cache_flush(struct drm_device *);
 945 extern bool nv04_fifo_cache_pull(struct drm_device *, bool);
 946 extern int  nv04_fifo_channel_id(struct drm_device *);
 947 extern int  nv04_fifo_create_context(struct nouveau_channel *);
 948 extern void nv04_fifo_destroy_context(struct nouveau_channel *);
 949 extern int  nv04_fifo_load_context(struct nouveau_channel *);
 950 extern int  nv04_fifo_unload_context(struct drm_device *);
 951
 952 /* nv10_fifo.c */
 953 extern int  nv10_fifo_init(struct drm_device *);
 954 extern int  nv10_fifo_channel_id(struct drm_device *);
 955 extern int  nv10_fifo_create_context(struct nouveau_channel *);
 956 extern void nv10_fifo_destroy_context(struct nouveau_channel *);
 957 extern int  nv10_fifo_load_context(struct nouveau_channel *);
 958 extern int  nv10_fifo_unload_context(struct drm_device *);
 959
 960 /* nv40_fifo.c */
 961 extern int  nv40_fifo_init(struct drm_device *);
 962 extern int  nv40_fifo_create_context(struct nouveau_channel *);
 963 extern void nv40_fifo_destroy_context(struct nouveau_channel *);
 964 extern int  nv40_fifo_load_context(struct nouveau_channel *);
 965 extern int  nv40_fifo_unload_context(struct drm_device *);
 966
 967 /* nv50_fifo.c */
 968 extern int  nv50_fifo_init(struct drm_device *);
 969 extern void nv50_fifo_takedown(struct drm_device *);
 970 extern int  nv50_fifo_channel_id(struct drm_device *);
 971 extern int  nv50_fifo_create_context(struct nouveau_channel *);
 972 extern void nv50_fifo_destroy_context(struct nouveau_channel *);
 973 extern int  nv50_fifo_load_context(struct nouveau_channel *);
 974 extern int  nv50_fifo_unload_context(struct drm_device *);
 975
 976 /* nv04_graph.c */
 977 extern struct nouveau_pgraph_object_class nv04_graph_grclass[];
 978 extern int  nv04_graph_init(struct drm_device *);
 979 extern void nv04_graph_takedown(struct drm_device *);
 980 extern void nv04_graph_fifo_access(struct drm_device *, bool);
 981 extern struct nouveau_channel *nv04_graph_channel(struct drm_device *);
 982 extern int  nv04_graph_create_context(struct nouveau_channel *);
 983 extern void nv04_graph_destroy_context(struct nouveau_channel *);
 984 extern int  nv04_graph_load_context(struct nouveau_channel *);
 985 extern int  nv04_graph_unload_context(struct drm_device *);
 986 extern void nv04_graph_context_switch(struct drm_device *);
 987
 988 /* nv10_graph.c */
 989 extern struct nouveau_pgraph_object_class nv10_graph_grclass[];
 990 extern int  nv10_graph_init(struct drm_device *);
 991 extern void nv10_graph_takedown(struct drm_device *);
 992 extern struct nouveau_channel *nv10_graph_channel(struct drm_device *);
 993 extern int  nv10_graph_create_context(struct nouveau_channel *);
 994 extern void nv10_graph_destroy_context(struct nouveau_channel *);
 995 extern int  nv10_graph_load_context(struct nouveau_channel *);
 996 extern int  nv10_graph_unload_context(struct drm_device *);
 997 extern void nv10_graph_context_switch(struct drm_device *);
 998 extern void nv10_graph_set_region_tiling(struct drm_device *, int, uint32_t,
 999                                          uint32_t, uint32_t);
1000
1001 /* nv20_graph.c */
1002 extern struct nouveau_pgraph_object_class nv20_graph_grclass[];
1003 extern struct nouveau_pgraph_object_class nv30_graph_grclass[];
1004 extern int  nv20_graph_create_context(struct nouveau_channel *);
1005 extern void nv20_graph_destroy_context(struct nouveau_channel *);
1006 extern int  nv20_graph_load_context(struct nouveau_channel *);
1007 extern int  nv20_graph_unload_context(struct drm_device *);
1008 extern int  nv20_graph_init(struct drm_device *);
1009 extern void nv20_graph_takedown(struct drm_device *);
1010 extern int  nv30_graph_init(struct drm_device *);
1011 extern void nv20_graph_set_region_tiling(struct drm_device *, int, uint32_t,
1012                                          uint32_t, uint32_t);
1013
1014 /* nv40_graph.c */
1015 extern struct nouveau_pgraph_object_class nv40_graph_grclass[];
1016 extern int  nv40_graph_init(struct drm_device *);
1017 extern void nv40_graph_takedown(struct drm_device *);
1018 extern struct nouveau_channel *nv40_graph_channel(struct drm_device *);
1019 extern int  nv40_graph_create_context(struct nouveau_channel *);
1020 extern void nv40_graph_destroy_context(struct nouveau_channel *);
1021 extern int  nv40_graph_load_context(struct nouveau_channel *);
1022 extern int  nv40_graph_unload_context(struct drm_device *);
1023 extern void nv40_grctx_init(struct nouveau_grctx *);
1024 extern void nv40_graph_set_region_tiling(struct drm_device *, int, uint32_t,
1025                                          uint32_t, uint32_t);
1026
1027 /* nv50_graph.c */
1028 extern struct nouveau_pgraph_object_class nv50_graph_grclass[];
1029 extern int  nv50_graph_init(struct drm_device *);
1030 extern void nv50_graph_takedown(struct drm_device *);
1031 extern void nv50_graph_fifo_access(struct drm_device *, bool);
1032 extern struct nouveau_channel *nv50_graph_channel(struct drm_device *);
1033 extern int  nv50_graph_create_context(struct nouveau_channel *);
1034 extern void nv50_graph_destroy_context(struct nouveau_channel *);
1035 extern int  nv50_graph_load_context(struct nouveau_channel *);
1036 extern int  nv50_graph_unload_context(struct drm_device *);
1037 extern void nv50_graph_context_switch(struct drm_device *);
1038 extern int  nv50_grctx_init(struct nouveau_grctx *);
1039
1040 /* nouveau_grctx.c */
1041 extern int  nouveau_grctx_prog_load(struct drm_device *);
1042 extern void nouveau_grctx_vals_load(struct drm_device *,
1043                                     struct nouveau_gpuobj *);
1044 extern void nouveau_grctx_fini(struct drm_device *);
1045
1046 /* nv04_instmem.c */
1047 extern int  nv04_instmem_init(struct drm_device *);
1048 extern void nv04_instmem_takedown(struct drm_device *);
1049 extern int  nv04_instmem_suspend(struct drm_device *);
1050 extern void nv04_instmem_resume(struct drm_device *);
1051 extern int  nv04_instmem_populate(struct drm_device *, struct nouveau_gpuobj *,
1052                                   uint32_t *size);
1053 extern void nv04_instmem_clear(struct drm_device *, struct nouveau_gpuobj *);
1054 extern int  nv04_instmem_bind(struct drm_device *, struct nouveau_gpuobj *);
1055 extern int  nv04_instmem_unbind(struct drm_device *, struct nouveau_gpuobj *);
1056 extern void nv04_instmem_prepare_access(struct drm_device *, bool write);
1057 extern void nv04_instmem_finish_access(struct drm_device *);
1058
1059 /* nv50_instmem.c */
1060 extern int  nv50_instmem_init(struct drm_device *);
1061 extern void nv50_instmem_takedown(struct drm_device *);
1062 extern int  nv50_instmem_suspend(struct drm_device *);
1063 extern void nv50_instmem_resume(struct drm_device *);
1064 extern int  nv50_instmem_populate(struct drm_device *, struct nouveau_gpuobj *,
1065                                   uint32_t *size);
1066 extern void nv50_instmem_clear(struct drm_device *, struct nouveau_gpuobj *);
1067 extern int  nv50_instmem_bind(struct drm_device *, struct nouveau_gpuobj *);
1068 extern int  nv50_instmem_unbind(struct drm_device *, struct nouveau_gpuobj *);
1069 extern void nv50_instmem_prepare_access(struct drm_device *, bool write);
1070 extern void nv50_instmem_finish_access(struct drm_device *);
1071
1072 /* nv04_mc.c */
1073 extern int  nv04_mc_init(struct drm_device *);
1074 extern void nv04_mc_takedown(struct drm_device *);
1075
1076 /* nv40_mc.c */
1077 extern int  nv40_mc_init(struct drm_device *);
1078 extern void nv40_mc_takedown(struct drm_device *);
1079
1080 /* nv50_mc.c */
1081 extern int  nv50_mc_init(struct drm_device *);
1082 extern void nv50_mc_takedown(struct drm_device *);
1083
1084 /* nv04_timer.c */
1085 extern int  nv04_timer_init(struct drm_device *);
1086 extern uint64_t nv04_timer_read(struct drm_device *);
1087 extern void nv04_timer_takedown(struct drm_device *);
1088
1089 extern long nouveau_compat_ioctl(struct file *file, unsigned int cmd,
1090                                  unsigned long arg);
1091
1092 /* nv04_dac.c */
1093 extern int nv04_dac_create(struct drm_device *dev, struct dcb_entry *entry);
1094 extern uint32_t nv17_dac_sample_load(struct drm_encoder *encoder);
1095 extern int nv04_dac_output_offset(struct drm_encoder *encoder);
1096 extern void nv04_dac_update_dacclk(struct drm_encoder *encoder, bool enable);
1097
1098 /* nv04_dfp.c */
1099 extern int nv04_dfp_create(struct drm_device *dev, struct dcb_entry *entry);
1100 extern int nv04_dfp_get_bound_head(struct drm_device *dev, struct dcb_entry *dcbent);
1101 extern void nv04_dfp_bind_head(struct drm_device *dev, struct dcb_entry *dcbent,
1102                                int head, bool dl);
1103 extern void nv04_dfp_disable(struct drm_device *dev, int head);
1104 extern void nv04_dfp_update_fp_control(struct drm_encoder *encoder, int mode);
1105
1106 /* nv04_tv.c */
1107 extern int nv04_tv_identify(struct drm_device *dev, int i2c_index);
1108 extern int nv04_tv_create(struct drm_device *dev, struct dcb_entry *entry);
1109
1110 /* nv17_tv.c */
1111 extern int nv17_tv_create(struct drm_device *dev, struct dcb_entry *entry);
1112
1113 /* nv04_display.c */
1114 extern int nv04_display_create(struct drm_device *);
1115 extern void nv04_display_destroy(struct drm_device *);
1116 extern void nv04_display_restore(struct drm_device *);
1117
1118 /* nv04_crtc.c */
1119 extern int nv04_crtc_create(struct drm_device *, int index);
1120
1121 /* nouveau_bo.c */
1122 extern struct ttm_bo_driver nouveau_bo_driver;
1123 extern int nouveau_bo_new(struct drm_device *, struct nouveau_channel *,
1124                           int size, int align, uint32_t flags,
1125                           uint32_t tile_mode, uint32_t tile_flags,
1126                           bool no_vm, bool mappable, struct nouveau_bo **);
1127 extern int nouveau_bo_pin(struct nouveau_bo *, uint32_t flags);
1128 extern int nouveau_bo_unpin(struct nouveau_bo *);
1129 extern int nouveau_bo_map(struct nouveau_bo *);
1130 extern void nouveau_bo_unmap(struct nouveau_bo *);
1131 extern void nouveau_bo_placement_set(struct nouveau_bo *, uint32_t memtype);
1132 extern u16 nouveau_bo_rd16(struct nouveau_bo *nvbo, unsigned index);
1133 extern void nouveau_bo_wr16(struct nouveau_bo *nvbo, unsigned index, u16 val);
1134 extern u32 nouveau_bo_rd32(struct nouveau_bo *nvbo, unsigned index);
1135 extern void nouveau_bo_wr32(struct nouveau_bo *nvbo, unsigned index, u32 val);
1136
1137 /* nouveau_fence.c */
1138 struct nouveau_fence;
1139 extern int nouveau_fence_init(struct nouveau_channel *);
1140 extern void nouveau_fence_fini(struct nouveau_channel *);
1141 extern void nouveau_fence_update(struct nouveau_channel *);
1142 extern int nouveau_fence_new(struct nouveau_channel *, struct nouveau_fence **,
1143                              bool emit);
1144 extern int nouveau_fence_emit(struct nouveau_fence *);
1145 struct nouveau_channel *nouveau_fence_channel(struct nouveau_fence *);
1146 extern bool nouveau_fence_signalled(void *obj, void *arg);
1147 extern int nouveau_fence_wait(void *obj, void *arg, bool lazy, bool intr);
1148 extern int nouveau_fence_flush(void *obj, void *arg);
1149 extern void nouveau_fence_unref(void **obj);
1150 extern void *nouveau_fence_ref(void *obj);
1151 extern void nouveau_fence_handler(struct drm_device *dev, int channel);
1152
1153 /* nouveau_gem.c */
1154 extern int nouveau_gem_new(struct drm_device *, struct nouveau_channel *,
1155                            int size, int align, uint32_t flags,
1156                            uint32_t tile_mode, uint32_t tile_flags,
1157                            bool no_vm, bool mappable, struct nouveau_bo **);
1158 extern int nouveau_gem_object_new(struct drm_gem_object *);
1159 extern void nouveau_gem_object_del(struct drm_gem_object *);
1160 extern int nouveau_gem_ioctl_new(struct drm_device *, void *,
1161                                  struct drm_file *);
1162 extern int nouveau_gem_ioctl_pushbuf(struct drm_device *, void *,
1163                                      struct drm_file *);
1164 extern int nouveau_gem_ioctl_cpu_prep(struct drm_device *, void *,
1165                                       struct drm_file *);
1166 extern int nouveau_gem_ioctl_cpu_fini(struct drm_device *, void *,
1167                                       struct drm_file *);
1168 extern int nouveau_gem_ioctl_info(struct drm_device *, void *,
1169                                   struct drm_file *);
1170
1171 /* nv17_gpio.c */
1172 int nv17_gpio_get(struct drm_device *dev, enum dcb_gpio_tag tag);
1173 int nv17_gpio_set(struct drm_device *dev, enum dcb_gpio_tag tag, int state);
1174
1175 #ifndef ioread32_native
1176 #ifdef __BIG_ENDIAN
1177 #define ioread16_native ioread16be
1178 #define iowrite16_native iowrite16be
1179 #define ioread32_native  ioread32be
1180 #define iowrite32_native iowrite32be
1181 #else /* def __BIG_ENDIAN */
1182 #define ioread16_native ioread16
1183 #define iowrite16_native iowrite16
1184 #define ioread32_native  ioread32
1185 #define iowrite32_native iowrite32
1186 #endif /* def __BIG_ENDIAN else */
1187 #endif /* !ioread32_native */
1188
1189 /* channel control reg access */
1190 static inline u32 nvchan_rd32(struct nouveau_channel *chan, unsigned reg)
1191 {
1192         return ioread32_native(chan->user + reg);
1193 }
1194
1195 static inline void nvchan_wr32(struct nouveau_channel *chan,
1196                                                         unsigned reg, u32 val)
1197 {
1198         iowrite32_native(val, chan->user + reg);
1199 }
1200
1201 /* register access */
1202 static inline u32 nv_rd32(struct drm_device *dev, unsigned reg)
1203 {
1204         struct drm_nouveau_private *dev_priv = dev->dev_private;
1205         return ioread32_native(dev_priv->mmio + reg);
1206 }
1207
1208 static inline void nv_wr32(struct drm_device *dev, unsigned reg, u32 val)
1209 {
1210         struct drm_nouveau_private *dev_priv = dev->dev_private;
1211         iowrite32_native(val, dev_priv->mmio + reg);
1212 }
1213
1214 static inline u8 nv_rd08(struct drm_device *dev, unsigned reg)
1215 {
1216         struct drm_nouveau_private *dev_priv = dev->dev_private;
1217         return ioread8(dev_priv->mmio + reg);
1218 }
1219
1220 static inline void nv_wr08(struct drm_device *dev, unsigned reg, u8 val)
1221 {
1222         struct drm_nouveau_private *dev_priv = dev->dev_private;
1223         iowrite8(val, dev_priv->mmio + reg);
1224 }
1225
1226 #define nv_wait(reg, mask, val) \
1227         nouveau_wait_until(dev, 2000000000ULL, (reg), (mask), (val))
1228
1229 /* PRAMIN access */
1230 static inline u32 nv_ri32(struct drm_device *dev, unsigned offset)
1231 {
1232         struct drm_nouveau_private *dev_priv = dev->dev_private;
1233         return ioread32_native(dev_priv->ramin + offset);
1234 }
1235
1236 static inline void nv_wi32(struct drm_device *dev, unsigned offset, u32 val)
1237 {
1238         struct drm_nouveau_private *dev_priv = dev->dev_private;
1239         iowrite32_native(val, dev_priv->ramin + offset);
1240 }
1241
1242 /* object access */
1243 static inline u32 nv_ro32(struct drm_device *dev, struct nouveau_gpuobj *obj,
1244                                 unsigned index)
1245 {
1246         return nv_ri32(dev, obj->im_pramin->start + index * 4);
1247 }
1248
1249 static inline void nv_wo32(struct drm_device *dev, struct nouveau_gpuobj *obj,
1250                                 unsigned index, u32 val)
1251 {
1252         nv_wi32(dev, obj->im_pramin->start + index * 4, val);
1253 }
1254
1255 /*
1256  * Logging
1257  * Argument d is (struct drm_device *).
1258  */
1259 #define NV_PRINTK(level, d, fmt, arg...) \
1260         printk(level "[" DRM_NAME "] " DRIVER_NAME " %s: " fmt, \
1261                                         pci_name(d->pdev), ##arg)
1262 #ifndef NV_DEBUG_NOTRACE
1263 #define NV_DEBUG(d, fmt, arg...) do {                                          \
1264         if (drm_debug & DRM_UT_DRIVER) {                                       \
1265                 NV_PRINTK(KERN_DEBUG, d, "%s:%d - " fmt, __func__,             \
1266                           __LINE__, ##arg);                                    \
1267         }                                                                      \
1268 } while (0)
1269 #define NV_DEBUG_KMS(d, fmt, arg...) do {                                      \
1270         if (drm_debug & DRM_UT_KMS) {                                          \
1271                 NV_PRINTK(KERN_DEBUG, d, "%s:%d - " fmt, __func__,             \
1272                           __LINE__, ##arg);                                    \
1273         }                                                                      \
1274 } while (0)
1275 #else
1276 #define NV_DEBUG(d, fmt, arg...) do {                                          \
1277         if (drm_debug & DRM_UT_DRIVER)                                         \
1278                 NV_PRINTK(KERN_DEBUG, d, fmt, ##arg);                          \
1279 } while (0)
1280 #define NV_DEBUG_KMS(d, fmt, arg...) do {                                      \
1281         if (drm_debug & DRM_UT_KMS)                                            \
1282                 NV_PRINTK(KERN_DEBUG, d, fmt, ##arg);                          \
1283 } while (0)
1284 #endif
1285 #define NV_ERROR(d, fmt, arg...) NV_PRINTK(KERN_ERR, d, fmt, ##arg)
1286 #define NV_INFO(d, fmt, arg...) NV_PRINTK(KERN_INFO, d, fmt, ##arg)
1287 #define NV_TRACEWARN(d, fmt, arg...) NV_PRINTK(KERN_NOTICE, d, fmt, ##arg)
1288 #define NV_TRACE(d, fmt, arg...) NV_PRINTK(KERN_INFO, d, fmt, ##arg)
1289 #define NV_WARN(d, fmt, arg...) NV_PRINTK(KERN_WARNING, d, fmt, ##arg)
1290
1291 /* nouveau_reg_debug bitmask */
1292 enum {
1293         NOUVEAU_REG_DEBUG_MC             = 0x1,
1294         NOUVEAU_REG_DEBUG_VIDEO          = 0x2,
1295         NOUVEAU_REG_DEBUG_FB             = 0x4,
1296         NOUVEAU_REG_DEBUG_EXTDEV         = 0x8,
1297         NOUVEAU_REG_DEBUG_CRTC           = 0x10,
1298         NOUVEAU_REG_DEBUG_RAMDAC         = 0x20,
1299         NOUVEAU_REG_DEBUG_VGACRTC        = 0x40,
1300         NOUVEAU_REG_DEBUG_RMVIO          = 0x80,
1301         NOUVEAU_REG_DEBUG_VGAATTR        = 0x100,
1302         NOUVEAU_REG_DEBUG_EVO            = 0x200,
1303 };
1304
1305 #define NV_REG_DEBUG(type, dev, fmt, arg...) do { \
1306         if (nouveau_reg_debug & NOUVEAU_REG_DEBUG_##type) \
1307                 NV_PRINTK(KERN_DEBUG, dev, "%s: " fmt, __func__, ##arg); \
1308 } while (0)
1309
1310 static inline bool
1311 nv_two_heads(struct drm_device *dev)
1312 {
1313         struct drm_nouveau_private *dev_priv = dev->dev_private;
1314         const int impl = dev->pci_device & 0x0ff0;
1315
1316         if (dev_priv->card_type >= NV_10 && impl != 0x0100 &&
1317             impl != 0x0150 && impl != 0x01a0 && impl != 0x0200)
1318                 return true;
1319
1320         return false;
1321 }
1322
1323 static inline bool
1324 nv_gf4_disp_arch(struct drm_device *dev)
1325 {
1326         return nv_two_heads(dev) && (dev->pci_device & 0x0ff0) != 0x0110;
1327 }
1328
1329 static inline bool
1330 nv_two_reg_pll(struct drm_device *dev)
1331 {
1332         struct drm_nouveau_private *dev_priv = dev->dev_private;
1333         const int impl = dev->pci_device & 0x0ff0;
1334
1335         if (impl == 0x0310 || impl == 0x0340 || dev_priv->card_type >= NV_40)
1336                 return true;
1337         return false;
1338 }
1339
1340 #define NV_SW                                                        0x0000506e
1341 #define NV_SW_DMA_SEMAPHORE                                          0x00000060
1342 #define NV_SW_SEMAPHORE_OFFSET                                       0x00000064
1343 #define NV_SW_SEMAPHORE_ACQUIRE                                      0x00000068
1344 #define NV_SW_SEMAPHORE_RELEASE                                      0x0000006c
1345 #define NV_SW_DMA_VBLSEM                                             0x0000018c
1346 #define NV_SW_VBLSEM_OFFSET                                          0x00000400
1347 #define NV_SW_VBLSEM_RELEASE_VALUE                                   0x00000404
1348 #define NV_SW_VBLSEM_RELEASE                                         0x00000408
1349
1350 #endif /* __NOUVEAU_DRV_H__ */